60进制计数器课程设计报告.pdf

60进制计数器课程设计报告--第1页

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电子技术基础实验

课程设计

60进制计数器

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一、实验目的

（一）掌握中规模集成计数器74LS161的引脚图和逻辑功能。

（二）熟悉555集成定数器芯片的引脚图。

（三）利用74LS161和555定时器构成60进制计数器。

（四）在Multisim软件中仿真60进制计数器。

二、实验容

（一）集成计数器74LS161逻辑功能验证。

（二）用555定时器构成多谐振荡器。

（三）用两片74LS161和555定时器构成60进制计数器。

三、集成计数器介绍

（一）集成计数器74LS161管脚介绍

74LS161是4位二进制同步加法计时器。图1为它的管脚排列图，集

成芯片74LS161的CLR是异步清零端（低电平有效），LOAD是异步预置

数控制端（低电平有效）。CLK是时钟脉冲输入端，RCO是进位输出端，

ENP、ENT是计数器使能端，高电平有效。A、B、C、D是数据输入端；

QA、QB、QC、QD是数据输出端。

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图174LS161管脚排列图

（二）集成计数器74LS161功能介绍

由表1可知，74LS161具有以下功能：

1．异步清零。当CLR=0时，无论其他各输入端的状态如何，计数器均

被直接置“0”。

2．同步预置数。当CLR=1、LOAD=0且在CP上升沿作用时，计数器

将ABCD同时置入QA、QB、QC、QD,使QA、QB、QC、QD=ABCD。

3．保持（禁止）。CLR=LOAD=1且ENP、ENT=0时，无论有无CP脉

冲作用，计数器都将保持原有的状态不变（停止计数）。

4．计数。CLR=LOAD=ENP=ENT=1时，74LS161处于计数状态。

表174LS161功能表

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