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EDA技术实用教程 第8章 系统优化和时序分析 8.1 资源优化 8.1.1 资源共享 8.1 资源优化 8.1.1 资源共享 8.1 资源优化 8.1.1 资源共享 8.1 资源优化 8.1.1 资源共享 8.1 资源优化 8.1.1 资源共享 8.1 资源优化 8.1.2 逻辑优化 8.1 资源优化 8.1.2 逻辑优化 8.1 资源优化 8.1.3 串行化 8.1 资源优化 8.1.3 串行化 接下页 8.1 资源优化 接上页 8.1.3 串行化 8.2 速度优化 8.2.1 流水线设计 8.2 速度优化 8.2.1 流水线设计 8.2 速度优化 8.2.1 流水线设计 8.2 速度优化 8.2.1 流水线设计 8.2 速度优化 8.2.1 流水线设计 8.2 速度优化 8.2.1 流水线设计 8.2 速度优化 8.2.2 寄存器配平 8.2 速度优化 8.2.2 寄存器配平 8.2 速度优化 8.2.3 关键路径法 8.2 速度优化 8.2.4 乒乓操作法 8.2 速度优化 8.2.5 加法树法 加法树速度优化技术部分类似于流水线法。 2输入加法树结构 若将加法树逐级拓展，可以实现更长的树结构。 8.3 优化设置与时序分析 8.3.1 使用Design Assistant检查设计可靠性 8.3 优化设置与时序分析 8.3.2 增量布局布线控制设置 8.3 优化设置与时序分析 8.3.3 时序设置与分析 8.3 优化设置与时序分析 8.3.4 查看时序分析结果 8.3 优化设置与时序分析 8.3.5 适配优化设置示例 （1）建立工程 （2 ）打开Assignment Editor对话框 8.3 优化设置与时序分析 8.3.5 适配优化设置示例 （3 ）选项设置 8.3 优化设置与时序分析 8.3.6 LogicLock优化技术 Quartus II提供了一种非常优秀的优化技术，即逻辑锁定技术 （Logic Lock）。 Quartus II支持逻辑锁定技术的FPGA器件系列有APEX20K 、 APEXII 、Excalibur、Cyclone/II/III和Stratix/II/III等。 习 题 8-1 利用资源共享的面积优化方法对例8-9程序进行优化（仅要求在面积 上优化）。 习 题 8-2 试通过优化逻辑的方式对图8-20所示的结构进行改进，给出VHDL代 码和结构图。 习 题 8-3 已知4阶直接型FIR滤波器的数学表达式如下： y( n)=x(n)h(0)+x(n-1)+x(n-2)h(2)+x(n-3)h(3) x(n)与x(n-m) ，m=0，1，2，3是延迟关系，m表示延迟的clk 数。x(n-m)与 h(m)的位宽均为8位，y(n )为10位