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基于Cadence ADE的555定时器仿真设计.docx

发布:2023-02-16约1.42万字共23页下载文档
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题 目: 基于Cadence?ADE的555定时器仿真设计 PAGE PAGE 18 摘 要 本论文基于Cadence ADE平台设计了一款集模拟、数字于一体的CMOS集成电路555定时器,该电路运用Cadence软件强大的仿真能力,通过设置合理的相关参数,实现对电压比较器、SR锁存器、放电三极管、缓存器等子模块的仿真设计,并完成对整个电路的绘制与仿真测试。最后将测试仿真图像与预期理论图像进行比较,检验是否达到预期的效果,以及相应的功能实现。本论文设计的555定时器在实际运用中具有成本低,性能稳定可靠,只需外接几个电容电阻便可实现多谐振荡器,单稳态触发器以及施密特触发器等脉冲产生与变
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